接地開關上拉電阻阻值的選擇原則包含: 1、從節(jié)儉功耗及芯片的灌電流能力斟酌應當足夠大；接地開關電阻大，電流小。 2、從確保足夠的驅(qū)動電流斟酌應當足夠小；電阻小，電流大。 3、接地開關對高速電路，過大的上拉電阻可能邊沿變平緩。綜合斟酌 以上三點,通常在1k到10k之間選取。接地開關對下拉電阻也有類似事理 對上拉電阻和下拉電阻的選擇應連系開關管特性和下級電路的輸入特性進行設定，主要需要斟酌以下幾個因素： 1．接地開關驅(qū)動能力與功耗的平衡。以上拉電阻為例，一般地說，上拉電阻越小，驅(qū)動能力越強，但功耗越大，設計是應注意兩者之間的平衡。 2． 下級接地開關電路的驅(qū)動需求。同樣以上拉電阻為例，當輸出高電平時，開關管斷開，上拉電阻應適被選擇以能夠向下級電路提供足夠的電流。 3． 凹凸電平的設定。分歧電路的凹凸電平的門檻電平會有分歧，接地開關電阻應適當設定以確保能輸出正確的電平。以上拉電阻為例，當輸出低電平時，開關管導通，上拉電阻和開關管導通電阻分壓值應確保在零電平門檻之下。 4． 頻率特性。以上拉電阻為例，上拉電阻和開關管漏源級之間的電容和下級電路之間的輸入電容會形成RC延遲，電阻越大，延遲越大。接地開關上拉電阻的設定應斟酌電路在這方面的需求。 下拉電阻的設定的原則和上拉電阻是一樣的。 OC門輸出高電平時是一個高阻態(tài)，其上拉電流要由上拉電阻來提供，設輸入端每端口不大于100uA,設輸出口驅(qū)動電流約500uA，尺度工作電壓是5V，輸入口的凹凸電平門限為0.8V(低于此值為低電平)；2V(高電平門限值)。 選上拉電阻時： 500uA x 8.4K= 4.2即選大于8.4K時輸出端能下拉至0.8V以下，此為最小阻值，再小就拉不下來了。如果接地開關輸出口驅(qū)動電流較大，則阻值可減小，包管下拉時能低于0.8V即可。 當輸出高電平時，疏忽管子的漏電流，兩輸入口需200uA 200uA x15K=3V即上拉電阻壓降為3V，輸出口可達到2V，此阻值為最大阻值，再大就拉不到2V了。選10K可用。COMS門的可參考74HC系列 設計時管子的漏電流不成疏忽，IO口實際電流在分歧電平下也是分歧的，上述僅僅是原理，一句話概括為：輸出高電平時要喂飽后面的輸入口，輸出低電平不要把輸出口喂撐了（否則多余的電流喂給了級聯(lián)的輸入口，高于低電平門限值就不靠得住了） 在數(shù)字電路中不消的輸入腳都要接固定電平，通過1k電阻接高電平或接地。 1. 電阻作用： l 接地開關接電組就是為了避免輸入端懸空 l 削弱外部電流對芯片發(fā)生的干擾 l 呵護cmos內(nèi)的呵護二極管,一般電流不大于10mA l 上拉和下拉、限流 l 1. 改變電平的電位，經(jīng)常使用在TTL-CMOS匹配 2. 在引腳懸空時有確定的狀態(tài) 3.增加高電平輸出時的驅(qū)動能力。 4、為OC門提供電流 l 那要看輸出口驅(qū)動的是什么器件，如果該器件需要高電壓的話，而輸出口的輸出電壓又不敷，就需要加上拉電阻。 l 如果有上拉電阻那它的端口在默認值為高電平你要控制它必須用低電平才能控制如三態(tài)門電路三極管的集電極，或二極接地開關管正極去控制把上拉電阻的電流拉下來成為低電平。反之， l 尤其用在接口電路中,為了取得確定的電平,一般采取這種體例,以包管正確的電路狀態(tài),以免發(fā)生意外,好比,在電機控制中,逆變橋上下橋臂不克不及直通,如果它們都用同一個單片機來驅(qū)動,必須設置初始狀態(tài).避免直通! 2、定義： l 上拉就是將不確定的信號通過一個電阻嵌位在高電平！電阻同時起限流作用！下拉同理！ l 上拉是對器件注入電流，下拉是輸出電流 l 弱強只是上拉電阻的阻值分歧，沒有什么嚴格區(qū)分 l 對非集電極（或漏極）開路輸出型電路（如普通門電路）提升電流和電壓的能力是有限的，上拉電阻的功能主要是為集電極開路輸出型電路輸出電流通道。 3、為什么接地開關要使用拉電阻： l 一般作單鍵觸發(fā)使用時，如果IC自己沒有內(nèi)接電阻，為了使單鍵維持在不被觸發(fā)的狀態(tài)或是觸發(fā)后回到原狀態(tài)，必須在IC外部另接一電阻。 l 數(shù)字電路有三種狀態(tài)：高電平、低電平、和高阻狀態(tài)，有些應用場合不希望呈現(xiàn)高阻狀態(tài)，可以通過上拉電阻或下拉電阻的體例使處于穩(wěn)定狀態(tài)，具體視設計要求而定！ l 一般說的是I/O端口，有的可以設置，有的不成以設置，有的是內(nèi)置，有的是需要外接，I/O端口的輸出類似與一個三極管的C，當C接通過一個電阻和電源連接在一起的時候，該電阻成為上C拉電阻，也就是說，如果該端口正常時為高電平，C通過一個電阻和地連接在一起的時候，接地開關該電阻稱為下拉電阻，使該端口平時為低電平，作用嗎： 好比：當一個接有上拉電阻的端口設為輸如狀態(tài)時，他的常態(tài)就為高電平，用于檢測低電平的輸入。 l 上拉電阻是用來解決總線驅(qū)動能力不足時提供電流的。一般說法是拉電流，下拉電阻是用來吸收電流的，也就是你同學說的灌電流 電阻在選用時，選用顛末計較后與尺度值最相近的一個！ P0為什么要上拉電阻原因有： 1. P0口片內(nèi)無上拉電阻 2. P0為I/O口工作狀態(tài)時，上方FET被關斷，從而輸出腳浮空，因此P0用于輸出線時為開漏輸出。 3. 由于片內(nèi)無上拉電阻，上方FET又被關斷，P0輸出1時無法拉升端口電平。 P0是雙向口，其它P1，P2，P3是準雙向口。 不錯準雙向口是因為在讀外部數(shù)據(jù)時要先“準備”一下，為什么要準備一下呢？ 單片機在讀準雙向口的端口時，接地開關現(xiàn)應給端口鎖存器賦1，目的是使FET關斷，不至于因片內(nèi)FET導通使端口鉗制在低電平。 上下拉一般選10k！ 芯片的上拉/下拉電阻的作用 最常見的用途是,假定有一個三態(tài)的門帶下一級門.如果直接把三態(tài)的輸出接在下一級的輸入上,當三態(tài)的門為高阻態(tài)時,下一級的輸入就如同漂空一樣.可能引起邏輯的毛病,對MOS電路也許是有破壞性的.所以用電阻將下一級的輸入拉高或拉低,既不影響邏輯又保正輸入不會漂空. 改變電平的電位，經(jīng)常使用在TTL-CMOS匹配； 在引腳懸空時有確定的狀態(tài)； 為OC門的輸出提供電流； 作為端接電阻； 接地開關在試驗板上等于多了一個測試點，特別對板上表貼芯片多的更好，免得割線； 嵌位； 上、下拉電阻的作用良多，好比抬高信號峰峰值，增強信號傳輸能力， 避免信號遠距離傳輸時的線上反射，調(diào)度信號電平級別等等！當然還有其他的作用了具體的應用體例要看在什么場合，什么目的，至于參數(shù)更不克不及一概而定，要看電路其他參數(shù)而定，好比通經(jīng)常使用在輸入腳上的上拉電阻如果是為了抬高峰峰值，就要參考該引腳的內(nèi)阻來定電阻值的！另外，沒有說輸入加下拉，輸出加上拉的，有時候沒了某個目的也可能同時既有上拉又有下拉電阻的！ 加接地電阻－－下拉 加接電源電阻－－上拉 對漏極開路或集電極開路輸出的器件需要接地開關加上拉電阻才可能工作。另外，普通的口，加上拉電阻可以提高抗干擾能力，可是會增加負載。 電源：+5V 普通的直立LED， 共八個，負極分袂接到一個大片子的管腳上， 用多大的上拉電阻適合？ 謝謝指教！ 一般LED的電流有幾個mA就夠了，最大不跨越20mA，依照這個你就應該可以算出上拉電阻值來了。 保獻起見，仍是讓他拉吧，(5-0.7)/10mA=400ohm,差不多吧,不安心就用2k的 奇怪，新出了管壓0.7V的LED了嗎？據(jù)我所知好象該是1.5V左右。我看幾百歐到1K都沒太大問題，一般的片子不會衰到10mA都抗不住吧？ 上拉電阻的作用：6N137的的輸出三極管C極，如果沒有上拉電阻，則該引腳上的電平不會發(fā)生隨B極電平的凹凸轉變。原因是它沒有接到任何電源上。如果接上了上拉電阻，則B極電平為高時，C極對地導通(相當于開關接通)，C極的電壓就變低；如B極電壓為低，則C極對地關斷，C極的電壓就升到高電平。為就是上面說的“將通斷轉換成凹凸電平”。你說的51與此圖有一定的分歧，參照著去理解吧。另外，一般地，C極低電平時器件從外部吸入電流的能力和高電平時向外部灌出電流的能力是紛歧樣的。器件輸出端常有Isink和Isource兩個參數(shù)，且前者往往大于后者。 下拉電阻接地開關的作用：所見不多，常見的是接到一個器件的輸入端，多作為抗干擾使用。這是由于一般的IC的輸入端懸空時易受干擾或器件掃描時有間隙泄漏電壓而影響電路的性能。后者，我們在某批設備中曾碰到過。 上拉電阻接地開關的阻值主要是要顧及端口的低電平吸入電流的能力。例如在5V電壓接地開關下，加1K上拉電阻，將會給端口低電平狀態(tài)增加5mA的吸入電流。在端口能承受的條件下，上拉電阻小一點為好。提高負載能力、提高直流工作電平無信號是給電路提供確定的電平。
